VHDL 코드에 매우 간단한 문제가 있습니다. 나는 다음과 같은 코드를 정의했습니다 :VHDL의 배열 유형이 일치하지 않습니다.
type irf_array is array(0 to 1) of integer;
signal index : std_logic;
....
index := input(5);
out := irf_array(index);
나는 다음과 같은 오류 얻을이 간단한 코드의 fragment 컴파일하려고 : 사람이 내가 STD_LOGIC을 사용하는 방법에 대한 아이디어가있는 경우
Error: array index type mismatch [6.4]
그래서 내가 궁금를 값을 배열의 입력으로 사용합니다.
감사합니다.
, 나는 그것을 설명하지 않도록하는 것이 좋습니다 싶습니다 미리 "아주 간단하게". –