나는시스템 Verilog에서 중첩 된 인터페이스의 신호 별칭을 지정하는 방법은 무엇입니까?
interface a();
logic a;
endinterface: a
interface B();
logic b;
a A();
alias b = A.a; // THIS throws an error
endinterface: b
내가 interface B
에서 interface a
에 대한 주장을 작성하려는 의사 예와 같이 중첩 된 인터페이스, 뭔가를하지만 alias
신호에 저를 허용하지 않습니다. 다른 대안은 무엇입니까?
제안 사항?
나는 단언을 위해 A.a를 사용하겠다. 이 구문이 마음에 들지 않는다면, b – noobuntu